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嵌入式操作系统(Embedded OperaTIon System

更新时间:2019-10-20  浏览次数:

  MPEG-4视频压缩标准自问世以来受到人们的广泛关注。近几年,嵌入式应用中对MPEG-4播放器的实现已经成为众多厂家的研究热点。视频压缩的重要性以及其标准的发展历程。随着数字化、网络化全球一体化信息时代的来临,包括声音、、数据以及图像、影像在内的多媒体信息的维送和处理;其关键在于后编技术。由于MPEG-4系统庞大且需要大量的数据处理,因此在中实现MPEG-4软解码需要对其原算法进行充分的优化才能达到理想的性能。为此研究了一种基于ARM926EJ-S微处理器的MPEG-4解码算法的纯软件实现和优化的方法,通过对解码算法的软件优化,将QVGA格式MPEG-4码流在ARM9平台上的播放速度由原来的10 f/s提高到了37 f/s,完全达到了流畅播放的要求,具有很高的实用价值。目前,视频技术的应用范围很广,如网上可视会议、网上可视电子商务、网上政务、网上购物、网上学校、远程医疗、网上研讨会、网上展示厅、个人网上聊天、可视咨询等业务。

  论文研究使用的是基于ARM926EJ-S微处理器的综合开发平台,采用Linux操作系统,Linux是一类Unix计算机操作系统的统称。Linux操作系统的内核的名字也是“Linux”.Linux操作系统也是自由软件和开放源代码发展中最着名的例子。严格来讲,Linux这个词本身只表示Linux内核,但在实际上人们已经习惯了用Linux来形容整个基于Linux内核,并且使用GNU 工程各种工具和数据库的操作系统。Linux得名于计算机业余爱好者Linus Torvalds.外接320*240(QVGA格式)的LCD显示屏。ARM926EJ-S微处理器的时钟频率为190 MHz;采用5级整数流水线位Thumb指令集以及扩充的DSP指令集;支持数据Cache和指令Cache,具有更高的指令和数据处理能力。

  MPEG-4 SP级算法流程图如图1所示。优化的前期工作首先要将MPEG-4解码代码移植到开发平台上,然后对解码各个模块进行运算量和耗时分析,找出优化的重点内容。本文采用长度为376 934 B的AVI码流为测试序列,该码流共95帧,其中包括8个I帧,87个P帧。在未优化前测得的耗时分析结果如表1所示,整个测试序列解码播放完毕耗时10.05 s,解码播放速度只有9.5 f/s.

  ARM(AdvancedRISCMachines)是微处理器行业的一家知名企业,设计了大量高性能、廉价、耗能低的RISC处理器、相关技术及软件。技术具有性能高、成本低和能耗省的特点。适用于多种领域,比如嵌入控制、消费/教育类多媒体、DSP和移动式应用等。在ARM上用软件实现MPEG-4解码器的主要任务是提高解码速度,同时达到理想的画面播放效果。

  MPEG-4软解码以开源的XVID源代码做为参考,将XVID的C源代码移植到ARM平台上,在此基础上进行优化并测试优化后的解码播放性能。优化主要从3个方面进行:

  (2)对运算量较大、耗时较多的模块编写汇编函数代替C程序模块,提高程序执行效率。

  ARM的资源非常有限,在软件的结构安排上应尽量减少存储器访问,增加Cache的命中率,提高程序执行效率。

  优化前的源代码中,I帧与P帧的宏块解码软件结构如图2所示。在这个流程中,对于inter宏块,可变长解码(VLD),反扫描(Iscan),反量化(Iquant)三个过程中有3次的Block存储区读,2次Block存储区写和1次Data存储区写。源代码是指未编译的按照一定的程序设计语言规范书写的文本文件。 源代码(也称源程序),是指一系列人类可读的计算机语言指令。 在现代程序语言中,源代码可以是以书籍或者磁带的形式出现,但最为常用的格式是文本文件,这种典型格式的目的是为了编译出计算机程序。计算机源代码的最终目的是将人类可读的文本翻译成为计算机可以执行的二进制指令,这种过程叫做编译,通过编译器完成。

  合并后VLD从Block缓冲区读数据处理后马上进行反扫描和反量化,并将反量化后的数据存入Block中。整个过程只进行了一次Block缓冲区的读和写,不仅减少了两个读写操作,还减少了一个Data缓冲区的开辟。同时,对于P帧在VLD之后立即进行反量化还省去了大量零值的处理,这也是考虑合并的主要因素之一。

  通过以上两个步骤的合并处理,由测试序列测试之后发现解码播放完毕耗时5.23 s,速度提高了将近9 f/s,效果非常明显。

  MPEG-4每个宏块由6个子块组成。在XVID源代码中,宏块解码中的6个子块的所有处理一起进行,被放在一个大的for循环中。ARM9采用哈佛结构,分别拥有I-cache和D-cache,所有处理同时进行,某一子块的值会一直在D-cache中不被替换,对于D-cache是非常有利的,但是对于I-cache来说却会造成代码的不断替换而影响Cache效率。高速缓冲存储器(Cache)其原始意义是指存取速度比一般随机存取记忆体(RAM)来得快的一种RAM,一般而言它不像系统主记忆体那样使用DRAM技术,而使用昂贵但较快速的SRAM技术,也有快取记忆体的名称。对于I帧,由于其数据量比较大,数据替换的开销会远远大于代码替换。具体的做法是:

  另外对于I帧,IDCT与VOP重建也是可以合并的,这个过程可以减少存储器的访问次数。但是这个合并过程不符合ARM的Cache工作特性,因此优化的效果并不明显,这也是优化过程中矛盾折衷的明显体现。

  ADS编译器对C程序有很强的编译能力,但对于一些运算量较大,涉及存储器访问较多的模块,仍然需要使用ARM汇编优化。这部分主要是针对耗时较多的IDCT,插值,VOP重建等模块。在书写汇编函数时,要充分把握ARM处理器的特性,ARM处理器特点1、体积小、低功耗、低成本、高性能;2、支持Thumb(16位)/ARM(32位)双指令集,能很好的兼容8位/16位器件;3、大量使用寄存器,指令执行速度更快;4、大多数数据操作都在寄存器中完成;5、寻址方式灵活简单,执行效率高;6、指令长度固定。尽量避开多周期指令,避免流水线阻塞,合理分配寄存器以尽量减少存储器操作。汇编函数的优化包括以下几点:

  在ARM汇编中,相对耗时的指令主要有存储器操作指令load/stor,程序跳转指令B,乘法指令MUL等。在编写汇编函数时,要尽量的考虑这些指令的替换方案。

  对于存储器操作指令,可以采用多寄存器传送指令LDM/STM来替换。一次LDR指令需要5个指令周期,而N个寄存器传送的LDM指令只需要N+4个指令周期。IDCT、插值、VOP重建中的数据读取都是连续地址操作,可以一次读人4个甚至更多的数据到寄存器以减少程序的执行指令周期数。

  其次,一条程序跳转指令B需要3个指令周期,利用手写汇编可以避免ADS编译C时经常出现的函数跳转指令,同样减少了执行周期数。

  3.2.2避免流水线采用五级流水线,执行效率很高,但是如果指令设置不当,很容易造成流水线阻塞而影响执行效率。解决流水线互

  的办法主要是预装载和循环展开。预装载,即将接下来要用到的数据在不影响寄存器使用的情况下提前两个以上指令周期装载到寄存器中。这。

  循环展开,即将循环体内的主体多次循环将循环跳转次数减少。这样不仅可以减少B跳转指令带来的流水线刷新,同时可以在前一个循环中通过预装载下一个循环需要用的数据来避免流水线尽量减少存储器操作

  将经常使用的数据保持在寄存器中,避免每次用数据时都从存储器读取。尤其在IDCT中,尽量将一行或一列的数据一直保持在寄存器中,寄存器的执行效率是最高的,合理的分配寄存器和利用堆栈可以使程序更优。

  一个高效的汇编程序可以使整个性能有较多的改善,通过ARM汇编函数的替换,测试序列解码播放完毕耗时3.1 s,解码速度提高了8 f/s.

  ARM汇编的好处不仅在于执行效率高,还在于可以充分利用ARM处理32位数据的特性,寻找快速算法和并行算法。

  对于插值函数,可以采用并行算法来一次处理多个象素。每个象素是一个8位数据,而ARM处理器是32位,因此可以改进算法一次处理4个象素。插值中的关键算法是:

  rounding是码流中一个取0或1的参数。我们可以改进这个算法4个象素一起处理。通过分析知道,可以将式(1)改为A/2+B/2+C,C也应该是一个取0或者取1的值。分析的结果发现,当rounding为0时,C=(A∣B)当rounding为1时,C=(A&B)&0X01.此时我们可以用4个象素组成两个32位的字W1,W2,利用公式:

  通过这一步骤的优化,测试序列解码播放完毕耗时2.56 s,解码速度提高了6 f/s,整体解码速度达到了37 f/s.

  本文对MPEG-4软解码器在ARM平台上的实现及优化的整体思路和步骤进行了阐述,优化结果理想,软解码播放速度由最初移植完毕时的10 f/s提高到了37 f/s.本文给出的优化方案可以进一步推广到H.264或者其他视频软解码系统基于ARM的应用中。全球的视讯业务需求猛增。现有的视讯业务应用主要以政府部门会议为主,在远程教育、远程医疗以及商用方面的应用很少,而国外90%的企业都在使用视讯业务,已是“信息高速公路”的主体通信业务,因此市场潜力巨大。在视讯业务中使用的视频压缩标准作为关键技术,其发展和应用也将是巨大的。

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  238A的引脚排列与LS238完全相同。器件输入与标准CMOS输出兼容;通过上拉电阻,它们与LSTTL输出兼容。 HC238A将三位地址解码为八个有效高电平输出之一。该器件具有三个片选输入,两个低电平有效和一个高电平有效,便于解复用,级联和芯片选择功能。通过使用地址输入来选择所需的设备输出来完成解复用功能。其中一个芯片选择用作数据输入,而其他芯片选择保持其有效状态。 特性 输出驱动能力:10 LSTTL负载 直接输出到CMOS,NMOS和TTL接口 工作电压范围:2.0至6.0 V 低输入电流:1.0μA CMOS器件的高抗噪性能 符合JEDEC定义的​​要求标准编号7A 芯片复杂度:100个FET或29个等效门 这些是无铅设备 应用 工业 电路图、引脚图和封装图...

  信息 MC14555B和MC14556B由互补MOS(CMOS)增强模式器件构成。每个解码器/解复用器有两个选择输入(A和B),一个低电平有效输入(E)和四个互斥输出(Q0,Q1,Q2,Q3)。 MC14555B使所选输出进入“高”状态,MC14556B使所选输出进入“低”状态。通过使用其他MC14555B或MC14556B器件,可以实现扩展解码,如二进制到十六进制(16进制)等。应用包括代码转换,地址解码,存储器选择控制和解复用(使用在数字数据传输系统中启用输入作为数据输入。 所有输入上的二极管保护 高电平有效或低电平有效输出 可扩展 电源电压范围= 3.0 Vdc至18 Vdc 所有缓冲输出 能够在额定温度下驱动两个低功耗TTL负载或一个低功耗肖特基TTL负载范围 无铅封装可用 电路图、引脚图和封装图...

  5B和MC14556B由互补MOS(CMOS)增强模式器件构成。每个解码器/解复用器有两个选择输入(A和B),一个低电平有效输入(E)和四个互斥输出(Q0,Q1,Q2,Q3)。 MC14555B使所选输出进入“高”状态,MC14556B使所选输出进入“低”状态。通过使用其他MC14555B或MC14556B器件,可以实现扩展解码,例如二进制到十六进制(16进制)等。 应用程序包括代码转换,地址解码,存储器选择控制和在数字数据传输系统中解复用(使用启用输入作为数据输入)。 特性 所有输入的二极管保护 高效或低有效输出 可扩展 电源电压范围= 3.0 Vdc至18 Vdc 所有缓冲输出 能力在额定温度范围内驱动两个低功率TTL负载或一个低功耗肖特基TTL负载 Pb - 免费套餐可用 电路图、引脚图和封装图...

  1B BCD至7段锁存器/解码器/驱动器采用单片结构的互补MOS(CMOS)增强型器件和NPN双极性输出驱动器构成。该电路提供4位存储锁存器,8421 BCD至7段解码器和输出驱动能力。灯测试(LTbar),消隐(BIbar)和锁存使能(LE)输入分别用于测试显示,关闭或脉冲调制显示器的亮度,以及存储BCD码。它可以直接或间接地与七段发光二极管(LED),白炽灯,荧光灯,气体放电或液晶读数器一起使用。 应用程序包括仪器(例如,计数器,DVM等)显示驱动程序,计算机/计算器显示驱动程序,驾驶舱显示驱动程序以及各种时钟,手表和计时器用途。 特性 低逻辑电路功耗 高电流源输出(向上)至25毫安) 代码的锁存存储 消隐输入 灯测试规定 读取所有非法输入组合的消隐 灯泡强度调制能力 时间共享(多路复用)设施 电源电压范围= 3.0 V至18 V 能够驱动两个低功耗TTL负载,一个低功耗肖特基TTL Loa d或额定温度范围内的两个HTL负载 芯片复杂度:216个FET或54个等效门 所有输入上的三重二极管保护 这些器件采用无铅封装。此处的规格适用于标准和无铅器件...

  8B解码器的构造使得四个输入上的8421 BCD码提供十进制(十分之一)解码输出,而一个3位二进制输入提供一个解码八进制(八分之一)代码输出D强制为逻辑“0”。通过使用其他MC14028B器件,可以实现扩展解码,例如二进制到十六进制(十六分之一)等。该部分对代码转换,地址解码,存储器选择控制,解复用或读出解码很有用。 特性 所有输入上的二极管保护 电源电压范围= 3.0 Vdc至18 Vdc 能够在额定温度范围内驱动两个低功率TTL负载或一个低功率肖特基TTL负载 正逻辑设计 所有非法输入组合的低输出 与CD4028B类似。 无铅封装可用 电路图、引脚图和封装图...

  9是一款带共用输出使能的1:2解码器。该器件采用先进的CMOS技术制造,实现了超高速度和高输出驱动,同时能在很宽的V CC 工作范围内保持较低的静态功耗。该器件额定工作范围为1.65V至5.5VV CC 。当V CC 为0V时,输出和输出处于高阻抗状态。输入容差电压最高可达5.5 V,且与VCC工作范围无关。 特性 节省空间的SC70 6引线表面贴装封装 超小型MicroPak™无引线封装 超高速:V CC = 5V时,50pF内的t PD = 2.7 ns(典型值) 宽V CC 工作范围:1.65V到5.5V 掉电高阻抗输入/输出 耐过压输入促进5V至3V的转换 专利噪声/电磁干扰(EMI)消减电路已实施 应用 此产品是一般用途,适用于许多不同的应用。 电路图、引脚图和封装图...

  NC7SV19 TinyLogic ULP-A 1:2解码器/解复用器

  9是一款1:2解码器/解复用器,属于飞兆TinyLogic®中的超低功耗A(ULP-A)系列.ULP-A是要求极高速度,高驱动和低功耗的应用的理想选择。此产品设计用于宽低电压工作范围(0.9V到3.6V的V CC ),适合驱动和速度要求高于TinyLogic ULP系列的应用,但NC7SV19专为优化功耗和速度而设计,采用先进的CMOS技术制造,在实现高速运行的同时最佳的低功耗运行特点。 特性 0.9V至3.6VV CC 电源操作范围 V CC 为0.9 V至3.6 V时,耐过压I / O为3.6 V 极高速度t PD 1.5 ns(典型值),2.7V到3.6VV CC 2.0 ns(典型值),2.3V到2.7VV CC 3.0 ns(典型值),1.65V到1.95VV CC 4.0 ns(典型值),1.4V至1.6VV CC 8.0 ns(典型值),1.1V至1.3VV CC 16.0 ns(典型值),0.9 VV CC 断电高阻抗输入和输出 高静态驱动(I OH / I OL )±24 mA @ 3.00VV CC ±18 mA @ 2.30VV CC ±6 mA @ 1.65VV CC ±4 mA @ 1.4VV CC ±2 mA @ 1.1VV CC ±0.1 mA @ 0.9VV CC 使用专有Quiet Series™噪声/电磁干扰...

  9是一款单通道1:2解码器/解复用器,属于飞兆TinyLogic®中的超低功耗(ULP)系列。适用于电池使用寿命至关重要的应用,此产品专为0.9V至3.6VV CC 的V CC 工作范围内的超低功耗而设计。内部电路由最小量的反相器层级组成(包括输出缓冲NC7SP19(适合于较低的驱动需求)设计独特,可优化功率和速度,而且是采用先进的CMOS技术制造,以实现同低最佳的高速操作,同时保持极低的CMOS功耗。 特性 0.9V至3.6VV CC 电源操作范围 V CC 为0.9 V至3.6 V时,耐过压I / O为3.6 V t PD 3.0 ns(典型值),3.0 V至3.6 VV CC 4.0 ns(典型值),2.3 V至2.7 VV CC 5 .0 ns(典型值),1.65 V至1.95 VV CC 7.0 ns(典型值),1.40 V至1.60 VV CC 11.0 ns(典型值),1.10 V至1.30 VV CC 30.0 ns(典型值),0.90VV CC 断电高阻抗输入和输出 静态驱动(I OH / I OL )3.00VV CC 时±2.6 mA,2.30VV CC 时,±2.1 mA,1.65VV CC 时±1.5 mA,1.40VV CC ±1.0 mA,1.10VV CC 时±0.5 mA,0.9VV CC 时±20μA...

  8A是采用硅栅极CMOS技术制造的先进的高速CMOS 3:8解码器。它实现了与等效双极型肖特基TTL相似的高速运行,同时保持了CMOS低功耗。当设备启动后,3个二进制位的选择输入(A 0 ,A 1 和A 2 )决定哪一个输出(O# 0 -O# 7 )将转为低电平。当使能输入E 3 保持低电平或者E# 1 或E# 2 保持高电平时,解码功能被禁用且所有输出转为高电平。提供E 3 ,E# 1 和E# 2 输入以简化串联连接和作为存储器系统的一个地址解码器。保护电路确保不管电源电压如何,0V至7V可施加到输入引脚,输出引脚V CC = 0V。这些电路可防止器件由于电源和输入/输出电压不匹配而受损。此器件可用于连接5V至3V系统和两个电源系统(例如备用电池)。 特性 高速:V CC = 5V时,t PD = 7.6 ns(典型值) 低功耗:T A = 25°C时,I CC =2μA(最大值) 所有输入和输出上都提供掉电保护 引脚和功能与74HCT138兼容 应用 此产品是一般用途,适用于许多不同的应用。 电路图、引脚图和封装图...

  是采用硅栅极CMOS技术制造的先进的高速CMOS 3输入“或非”门。它实现了与等效双极型肖特基TTL相似的高速运行,同时保持了CMOS低功耗。当设备启动后,3个二进制位的选择输入(A 0 ,A 1 和A 2 )决定哪一个输出(O # 0 -O# 7 )将转为低电平。当使能输入E 3 保持低电平或者E# 1 或E# 2 保持高电平时,解码功能被禁用且所有输出转为高电平。提供E 3 ,E# 1 和E# 2 输入以简化串联连接和作为存储器系统的一个地址解码器。输入保护电路确保0V至7V可应用于输入引脚,无需考虑电源电压。此器件可用此连接电压和电压系;“

  特性 高速:T A = 25°C时,t PD = 5.7 ns(典型值) 低功耗:T A = 25°C时,我 CC =2μA(最大值) 高抗噪能力:V NIH = V NIL = 28%V CC (最小值) 所有输入上都提供掉电保护 引脚和功能与74HC138兼容 应用 此产品是一般用途,适用于许多不同的应用。 电路图、引脚图和封装图...

  是采用硅栅极CMOS技术制造的先进的高速CMOS双通道2:4解码器/解多路复用器。它实现了与等效双极型肖特基TTL相似的高速运行,同时保持了CMOS低功耗。有源低电平使能输入能用于门控或用作解多路复用器的数据输入。当使能输入保持为高电平时,所有四个输出均固定为高电平,与其他输入无关。输入保护电路确保0V至7V可应用于输入引脚,无需考虑电源电压。此器件可用于连接5V至3V系统和两个电源系统(例如备用电池)。电路可防止器件因电源和输入电压不匹配而受损。 特性 高速:T A = 25°C时, t PD = 5.0 ns(典型值) 低功耗:T A = 25°C时,I CC =2μA(最大值) 高抗能力:V NIH = V NIL = 28%V CC (最小值) 所有输入上都提供掉电保护 引脚和功能与74HC139兼容 应用 本产品是一般用途,适用于许多不同的应用。 电路图、引脚图和封装图...

  是一款高速1:8解码器/解复用器。此器件特别适合高速双极存储器芯片选择地址解码。只需使用三个LVX138器件,通过多路输入使能就能并行扩展至1:24解码器,或使用四个LVX138器件和一个反相器并行扩展至1:32解码器。 特性 输入电平从5V转换为3V 非常适合低功率/低噪声3.3V应用 保证同步开关噪声电平和动态阈值性能 应用 此产品是一般用途,适用于许多人不同的应用程序。 电路图、引脚图和封装图...

  是一款高速1:8解码器/解复用器。此器件特别适合高速存储器芯片选择地址解码。只需使用三个LCX138器件,通过多路输入使能就能并行扩展至1 :24解码器,或使用四个LCX138器件和一个反相器并行扩展至1:32解码器.74LCX138采用先进的CMOS技术制造,以在实现高速运行的同时保持CMOS低功耗。 特性 5V容许输入电压 提供2.3V到3.6VV CC 规格 6.0 ns t PD 最大值(V CC = 3.3V),10μAII CC 最大值 掉电高阻抗输入和输出 ±24 mA输出驱动(V CC = 3.0V) 实施专利噪声/电磁干扰(EMI)消减电路 闩锁性能超过500毫安 静电放电(ESD)性能:人体模型

  2000V机械模型

  200V 无铅DQFN包 应用 此产品是一般用途,适用于许多人不同的应用程序。 电路图、引脚图和封装图...

  CT139是一款高速双通道1:4解码器/解复用器。该器件包含两个独立解码器,每个解码器接受两个输入,提供四个有互斥低电平有效输出。每个解码器包含一个低电平有效使能输入,可用作4输出解复用器的数据输入。每半个AC / ACT139可用作函数生成器,提供两个变量的全部四个小项。 特性 我 CC 降低了50% 多功能能力 两个完全独立的1 :4解码器 低电平有互斥输出 24 mA输出源电流/灌电流 ACT139具有TTL兼容输入 应用 此产品是一般用途,适用适用于许多不同的应用程序。 电路图、引脚图和封装图...

  CT138是一款高速1:8解码器/解复用器。此器件特别适合高速双极存储器芯片选择地址解码。只需使用三个AC / ACT138器件,通过多路输入使能就能并行扩展至1:24解码器,或使用四个AC / ACT138器件和一个反相器并行扩展至1:32解码器。 特性 我 CC 降低了50% 解复用能力 多路输入使能,实现轻松扩展 低电平有互斥输出 24 mA输出源电流/灌电流 ACT138具有TTL兼容输入 应用 该产品是一般用途,适用于许多不同的应用。 电路图、引脚图和封装图...

  信息AC/ACT138是一款高速1:8解码器/解复用器。 此器件特别适合高速双极存储器芯片选择地址解码。 只需使用三个AC/ACT138器件,通过多路输入使能就能并行扩展至1:24解码器,或使用四个AC/ACT138器件和一个反相器并行扩展至1:32解码器。 I降低了50% 解复用能力 多路输入使能,实现轻松扩展 低电平有互斥输出 24 mA输出源电流/灌电流 ACT138具有TTL兼容输入

  信息AC/ACT139是一款高速双通道1:4解码器/解复用器。 该器件包含两个独立解码器,每个解码器接受两个输入,提供四个有互斥低电平有效输出。 每个解码器包含一个低电平有效使能输入,可用作4输出解复用器的数据输入。 每半个AC/ACT139可用作函数生成器,提供两个变量的全部四个小项。 I降低了50% 多功能能力 两个完全独立的1:4解码器 低电平有互斥输出 24 mA输出源电流/灌电流 ACT139具有TTL兼容输入...

  3B BCD至7段锁存器/解码器/驱动器设计用于液晶读出,采用互补MOS(CMOS)增强模式器件构建。该电路提供4位存储锁存器和8421 BCD至7段解码器和驱动器的功能。该器件能够反转输出组合的逻辑电平。相位(Ph),消隐(BI)和锁存禁用(LD)输入分别用于反转真值表相位,使显示空白并存储BCD码。对于液晶(LC)读数,方波被施加到电路的Ph输入和显示器的电共用背板。电路的输出直接连接到LC读出的段。对于其他类型的读数,如发光二极管(LED),白炽灯,气体放电和荧光读数,本数据表给出了连接图。 应用程序包括仪器(例如,计数器,DVM等)显示驱动程序,计算机/计算器显示驱动程序,驾驶舱显示驱动程序以及各种时钟,手表和计时器用途。 特性 闩锁存储代码 消隐输入 读取所有非法输入组合的消隐 直接LED(共阳极或阴极)驱动能力 电源电压范围= 3.0 V至18 V 能够驱动两个低功率TTL负载,一个低功耗肖特基TTL负载或两个HTL负载超过额定温度范围 CD4056A的引脚替换(引脚7连接到V SS )。 芯片复杂性:207个FET或52个等效门 无铅封装可用 电路图...

  信息 MC14514B和MC14515B是具有锁存输入的4至16线路解码器的两个输出选项。 MC14514B(输出有效高电平选项)在所选输出上显示逻辑“1”,而MC14515B(输出有效低电平选项)在所选输出上显示逻辑“0”。锁存器是R-S型触发器,其保持在选通脉冲从“1”到“0”之前呈现的最后输入数据。 4位锁存器/ 4至16线解码器的这些高和低选项由单通道结构中的N通道和P通道增强模式器件构成。锁存器是RS型触发器,数据在选通输入处入射,解码并在输出端呈现时被允许。这些互补电路主要用于低功耗和/或高噪声的解码应用需要免疫力。 电源电压范围= 3.0 Vdc至18 Vdc 能够在额定温度范围内驱动两个低功率TTL负载或一个低功率肖特基TTL负载 可提供无铅封装 电路图、引脚图和封装图...

  MC14515B 4位透明锁存器/ 4至16线线路解码器的两个输出选项,带有锁存输入。 MC14514B(输出有效高电平选项)在所选输出上显示逻辑“1”,而MC14515B(输出有效低电平选项)在所选输出上显示逻辑“0”。锁存器是R-S型触发器,其保持在选通脉冲从“1”到“0”之前呈现的最后输入数据。 4位锁存器/ 4至16线解码器的这些高和低选项由单通道结构中的N通道和P通道增强模式器件构成。锁存器是RS型触发器,数据在选通信号入射时被接纳,解码并在输出端呈现。 这些互补电路主要用于解码低功耗和/的应用或者需要高抗噪性。 特性 电源电压范围= 3.0 Vdc至18 Vdc 能够在额定温度范围内驱动两个低功率TTL负载或一个低功率肖特基TTL负载 无铅封装可用 电路图、引脚图和封装图...

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